[ 공과대학 - 전자공학과 ] Vivado와 FPGA를 이용한 디지털 시스템 설계
· 작성자 : 전자공학과 ·작성일 : 2024-08-14 11:34:57 ·조회수 : 634
운영내용 : FPGA를 이용한 디지털 회로 및 시스템설계 실습교육
교육기간 : 2024.08.21.(수)~2024.08.23.(금)
교육장소 : 공과대학 3호관 C428호
참여대상 : 전자공학과 대학원생 및 재학생 10명 내외
모집기간 : 2024.08.12.(월)~2024.08.16.(금)
추진주체 : 제주대학교 신산업분야 지식재산 융합인재 양성사업(전자공학과),
지식재산교육센터, 전자공학과
신청하기: https://forms.gle/u7t9E29AR9EFq9Zp7
문의처: 754-8336 (조교 강숙인)
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일자 |
시 간 |
교육 및 실습 내용 |
비고 |
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08.21. |
10:00 ~ 12:00 |
FPGA 소개, 환경설정, 툴 설치 |
이론 |
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12:00 ~ 13:00 |
점심 |
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13:00 ~ 15:00 |
애플리케이션 프로세서 아키텍처 개요 |
이론 및 실습 |
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15:00 ~ 17:00 |
프로세서 입출력 장치 |
실습 |
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08.22. |
10:00 ~ 12:00 |
메모리 리소트 소개 |
이론 |
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12:00 ~ 13:00 |
점심 |
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13:00 ~ 15:00 |
퍼포먼스 동작 이해 |
이론 및 실습 |
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15:00 ~ 17:00 |
소프트웨어 및 디버깅 |
실습 |
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08.23. |
10:00 ~ 12:00 |
Vitis 소개 |
이론 |
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12:00 ~ 13:00 |
점심 |
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13:00 ~ 15:00 |
하드웨어 소프트웨어 인터페이스 |
이론 및 실습 |
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15:00 ~ 17:00 |
애플리케이션 가속 과정정리 |
실습 |
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