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[ ] [핵심] 반도체 회로 설계 실무 교육 신청 안내

· 작성자 : 전자공학과      ·작성일 : 2024-06-17 17:03:29      ·조회수 : 901     

제주특별자치도 핵심역량강화지원사업으로 "반도체 회로 설계 실무 교육"을 아래와 같이 진행합니다. 


교육일시: 7월 20일 ~ 7월 22일
장소: 공과대학 3호관 C428
대상: 전자공학과 학부 및 대학원생 15명 내외
신청문의: 064-754-8336 (담당: 강숙인)




일자

시 간

활 동 내 용

비고

7/20()

(7시간)

13:00~16:00

(3시간)

고분해능 혼성신호 집적회로 설계 이론 기초

 

16:00~18:00

(2시간)

고분해능 혼성신호 집적회로 설계 실습 기초: 단위 블록 기반 Noise-shaping 구조 설계

19:00~21:00

(2시간)

7/21(

(10시간)

09:00~12:00

(3시간)

고분해능 혼성신호 집적회로 설계 이론 및 실습: 피드백 증폭기 설계

13:00~15:00

(2시간)

15:00~18:00

(3시간)

고분해능 혼성신호 집적회로 설계 이론 및 실습: 고분해능 필터 설계

19:00~21:00

(2시간)

7/22()

(3시간)

09:00~12:00

(3시간)

고분해능 혼성신호 집적회로 설계 이론 및 실습: 성능 평가 기법




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